通過條件
成 績 :60 分
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Syllabus
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Overview of IC Design flow
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Verilog 語法回顧
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作業一
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RTL review
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作業二
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Control unit
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RTL Design
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Datapath
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Overview of IP Authoring
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ncverilog使用教學
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DV 基礎使用教學
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DV 進階使用教學
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Final_Prj
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Final_Prj_hard
- 課程介紹
- 課程安排
- 評論